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集成芯片门数的估计

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发表于 2009-7-25 21:16:03 | 显示全部楼层 |阅读模式
在应力分析法中,计算集成芯片的失效率时要用到门数的估计,对某种芯片来说应该如何估计呢?xiexie
发表于 2009-7-26 13:35:45 | 显示全部楼层
参考datasheet
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发表于 2009-7-27 09:02:37 | 显示全部楼层

请问集成电路是如何进行预计的

相似的贴子,可以参考一下:http://www.kekaoxing.com/club/thread-6366-1-1.html
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发表于 2009-7-27 11:50:53 | 显示全部楼层
应力分析法是个什么东东?IC的可靠性仿真用的是BTA软件,不过这需要电路设计者自己去仿
,datasheet里应该看不到门数等信息。
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发表于 2009-7-27 16:38:25 | 显示全部楼层

回复 4楼 zhangxw 的帖子

可靠性预计中,有计数法,应力法。。
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发表于 2009-7-28 11:22:55 | 显示全部楼层
可靠性预计通常不靠谱,生产产家常有批评之词,对于IC的可靠性仿真,用的是BTA软件,软件的参数由厂家提供,但这个软件用的人不多,知道的就更少
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发表于 2009-8-1 18:46:59 | 显示全部楼层
原帖由zhangxw于2009-7-2811:22发表
可靠性预计通常不靠谱,生产产家常有批评之词,对于IC的可靠性仿真,用的是BTA软件,软件的参数由厂家提供,但这个软件用的人不多,知道的就更少

BTA软件发上来学习学习为何?
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